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VHDL Study 방법

학구적 접근

- VHDL Syntax를 충분히 습득한 후 실무

에 적용한다.

- 장 점 : VHDL의 Full Function 활용 가능.

- 단 점 : 습득에 많은 어려움. (시간,노력)

실무적 접근

- 필요한 최소한의 Syntax를 익힌 후 설계

시작, 필요한 내용을 추가 습득해 나간다.

- 장 점 : 단기간에 설계 업무 수행 가능.

- 단 점 : 활용 범위가 부분적 기능에만

국한되기 쉬움.