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DFF Architecture
Clk
Rst
D
Q
- Sequential Logic을 위한 Process 구문.
- if then else 구문.
- clock처리 구문.
library ieee;
use ieee.std_logic_1164.all;
entity DFF is
port (
D,Clk : in std_logic;
Rst : in std_logic;
Q : out std_logic
);
end entity DFF ;
architecture Behave of DFF is
begin process (Clk, Rst)
begin
if Rst = ‘1’ then
Q <= ‘0’ ;
elsif ( Clk’event and Clk = ‘1’ ) then
Q <= D ;
end if ;
end process;
end Behave;
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